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Thèses et mémoires

Des thèses et mémoires de nos étudiants sont conservés et consultables dans Papyrus, le dépôt institutionnel de l'Université de Montréal.

 

 

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Date Sort by date in ascending order Title Sort by title in ascending order
2024 Dynamic capacities and priorities in stable matching
2023 Weak core solution for the non-transferable utility kidney exchange game
2022 City decision-making : optimization of the location and design of urban green spaces
2020 The multilevel critical node problem : theoretical intractability and a curriculum learning approach
2021 Towards fairness in Kidney Exchange Programs
2023 Maximum flow-based formulation for the optimal location of electric vehicle charging stations
2022 A stochastic integer programming approach to reserve staff scheduling with preferences
2024 Strategic planning of intracity electric vehicle charging station locations with integrated advanced demand dynamics
2025 Nouvelle contraction algébrique appliquée au problème de tarification de réseau
2022 Game theoretical characterization of the multi-agent network expansion game
2022 Mixed-integer programming representation for symmetrical partition function form games
2020 Optimizing ANN Architectures using Mixed-Integer Programming
2025 A survey of state representation learning for deep reinforcement learning
2023 Small batch deep reinforcement learning
1993 Mise à jour automatique des cartes forestières à partir d'images satellites
1990 La prédiction des structures macromoléculaires par une approche symbolique
1993 Classification de conformations macromoléculaires
1987 Un système d'aide à la prédiction des structures tertiaires d'acides nucléiques et de protéines
1991 Un modèle de simulation basé sur les graphes de contraintes hiérarchiques
1995 Modèles des portes logiques pour l'analyse de délai par la méthode de réduction des intervalles
2002 Waveform narrowing : a constraint-based framework for timing analysis
1996 Un outil pour la spécification de matériel et la génération de modèles exécutables
1993 Analyse des systèmes modulaires asynchrones avec délais à intervalle fixe
1987 Vérification automatique de circuits transistors VSLI [i.e. VLSI]
1997 Logiciel pour la vérification par simulation de la spécification de haut niveau de systèmes matériels
1999 Méthode de simulation aléatoire guidée par un algorithme génétique pour la vérification du design de circuits numériques
1993 Application de machines à états étendues à la vérification et à la synthèse du matériel
1990 Une méthode efficace pour la compaction bidimensionnelle de circuits intégrés
1987 Un simulateur réparti et hiérarchique de circuits VLSI
1991 Un modèle de simulation au niveau des commutateurs à contrôle réparti
2001 Integrating MDG variable ordering in a VHDL-MDG design verification system
1991 Compactage bidimensionnel de circuits intégrés selon la méthode de graphe de contraintes
2001 Un générateur CP pour la vérification temporelle des contrôleurs d'interfaces
2000 Timing verification of interface specifications and controllers
2002 Synthèse de EFSM observatrices à partir de spécifications HAAD
1989 Un simulateur distribué de circuits intégrés à synchronisation mixte
1987 Interface usager de simulateurs de circuits VLSI
1999 Modèles et algorithmes pour la simulation des systèmes à temps réel
1997 Construction des machines à état abstrait à partir des modèles VHDL
1997 Vérification des propriétés temporelles des interfaces matérielles à l'aide de la programmation logique avec contraintes
2001 Compositional verification using interface recognizers/suppliers (IRS)
1989 Système de conception symbolique pour circuits intégrés à très grande échelle
2000 ACTC - une algèbre de processus temporisée pour la spécification et vérification d'interfaces matérielles
1992 Compaction hiérarchique bidimensionnelle de circuits intégrés
1992 Une méthode de gestion du processus de design des circuits intégrés
1990 Fault-tolerant sorting networks
1992 Génération de vecteurs de test pour circuits combinatoires par observabilité transversale
1999 Bounding of switching activity in logic circuits
1996 Multiway decision graphs and their applications in automatic formal verification of RTL designs
2001 Model reductions in MDG-based model checking
Number of results : 1649